Package: iverilog (10.2-1.1)

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Homepage [iverilog.icarus.com]

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compilatore Icarus Verilog

Icarus Verilog è pensato per compilare tutti i Verilog HDL come descritto nello standard IEEE-1364. Non è ancora del tutto pronto. Al momento gestisce vari costrutti strutturali e comportamentali.

Il compilatore può usare come target una simulazione o un elenco delle connessioni (EDIF).

Tags: Field: Electronics, Implemented in: C++, User Interface: interface::commandline, role::program

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dep: zlib1g (>= 1:1.2.0)

libreria di compressione - runtime

sug: gtkwave

visualizzatore per file di forma d'onda VCD (Value Change Dump)

Download iverilog

Download for all available architectures
Architecture	Package Size	Installed Size	Files
amd64	1,798.2 kB	6,267.0 kB	[list of files]
arm64	1,611.1 kB	6,024.0 kB	[list of files]
armhf	1,557.7 kB	4,153.0 kB	[list of files]
i386	1,883.2 kB	6,335.0 kB	[list of files]