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パッケージ: iverilog (10.2-1.1)

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Icarus verilog compiler

Icarus Verilog is intended to compile all of the Verilog HDL as described in the IEEE-1364 standard. It is not quite there yet. It does currently handle a mix of structural and behavioral constructs.

The compiler can target either simulation, or netlist (EDIF).

タグ: 分野: 電子工学, 実装言語: C++, ユーザインタフェース: interface::commandline, role::program

その他の iverilog 関連パッケージ

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